【TechWeb】7月17日音讯，楷登电子（美国 Cadence 公司）近来宣告推出 Cadence® Joules™ RTL Design Studio---这款新的处理方案可为用户供给有用的洞悉，有助于加速寄存器传输级（RTL）规划和完结流程。前端规划人员能够在一个一致的界面运用数字规划剖析和调试功用，在进入完结阶段之前全面优化 RTL 规划。凭借这一处理方案，用户能够经过 Cadence 抢先的 AI 产品系列，运用生成式 AI 进行 RTL 规划探究和大数据剖析。Joules RTL Design Studio 有助于用户快速精确地得出物理估计值，最多可将 RTL 出产力提高 5 倍，并完结高达 25% 的成果质量（QoR）改进。

　　Joules RTL Design Studio 扩大了 Cadence 现有的 Joules RTL Power Solution 处理方案，经过增加对功率、功用、面积和拥塞（PPAC）的可见性，覆盖了物理规划的方方面面。此外，这款新东西还顺便一系列有助于提高出产力的功用和优势，包含：

　　• 别出心裁的智能 RTL 调试辅佐体系：供给前期 PPAC 方针，在整个规划周期（逻辑、物理、出产完结）内供给有用的调试信息，协助工程师进行假定剖析，探究潜在的处理方案，尽量削减迭代，提高规划功用。

　　• 集成 lint 查看器：工程师能够按部就班地运转 lint 查看器，提早扫除数据和设置问题，削减过错并缩短规划完结时刻。

　　• 一致界面：给 RTL 规划人员带来了友爱高效的运用体会，反应物理完结状况，定位并分类违例问题，剖析瓶颈地点，以及 RTL、原理图和 layout 交互查询。

　　“现在，RTL 规划人员能够快速获取 PPAC 调试所需的一切物理信息。以往，他们只能比及完结阶段才干取得这些信息，而这个进程短则几天，长则数周，”Cadence 高档副总裁兼数字与签核事业部总经理 Chin-Chi Teng 博士表明，“Joules RTL Design Studio 让规划人员能够尽早发现并及时处理各种应战，终究加速产品上市。咱们的此番尽力再次完成了咱们的初始方针：将 RTL 收敛速度提高 5 倍，并完结 25% 的成果质量改进。”

　　Joules RTL Design Studio 是更广泛的 Cadence 数字全流程的一部分，助力客户加速规划收敛。新推出的东西和更广泛的流程支撑公司的智能体系规划（Intelligent System Design™）战略，旨在完结体系级芯片（SoC）杰出规划。

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